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- Choi, Kyoung Jin
- Energy Conversion Materials Lab.
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Full metadata record
| DC Field | Value | Language |
|---|---|---|
| dc.contributor.assignee | 울산과학기술원 / 한국과학기술연구원(KIST) | - |
| dc.contributor.author | 김인호 | - |
| dc.contributor.author | 최경진 | - |
| dc.contributor.author | 김주영 | - |
| dc.contributor.author | 이도권 | - |
| dc.contributor.author | 천시은 | - |
| dc.contributor.author | 이택성 | - |
| dc.contributor.author | 이경석 | - |
| dc.contributor.author | 이욱성 | - |
| dc.contributor.author | 정두석 | - |
| dc.contributor.author | 김원목 | - |
| dc.date.accessioned | 2024-01-23T19:36:05Z | - |
| dc.date.application | 2016-06-15 | - |
| dc.date.available | 2024-01-23T19:36:05Z | - |
| dc.date.registration | 2017-08-28 | - |
| dc.description.abstract | 본 발명은 텍스처링된 반도체 기판에 있어서, 상기 반도체 기판이 텍스쳐링된 포물선형 구조체와 상기 포물선형 구조체의 표면과 상기 반도체 기판의 표면을 포함하는 전체 표면에는 일정 간격의 나노홀 구조를 구비하되, 상기 포물선형 구조체의 표면에는 복수의 나노홀 구조가 형성된 것을 특징으로 하는 텍스처링된 반도체 기판을 제공한다. | - |
| dc.identifier.patentApplicationNumber | 10-2016-0074557 | - |
| dc.identifier.patentRegistrationNumber | 10-1773951 | - |
| dc.identifier.uri | https://scholarworks.unist.ac.kr/handle/201301/70826 | - |
| dc.title.alternative | METHOD FOR TEXTURING OF SEMICONDUCTOR SUBSTRATE, SEMICONDUCTOR SUBSTRATE MANUFACTURED BY THE METHOD AND DEVICE COMPRISING THE SAME | - |
| dc.title | 반도체 기판의 텍스쳐링 방법, 이 방법에 의해 제조된 반도체 기판 및 이를 포함하는 디바이스 | - |
| dc.type | Patent | - |
| dc.publisher.country | KO | - |
| dc.type.iprs | 특허 | - |
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